-- Copyright (C) 1991-2009 Altera Corporation -- Your use of Altera Corporation's design tools, logic functions -- and other software and tools, and its AMPP partner logic -- functions, and any output files from any of the foregoing -- (including device programming or simulation files), and any -- associated documentation or information are expressly subject -- to the terms and conditions of the Altera Program License -- Subscription Agreement, Altera MegaCore Function License -- Agreement, or other applicable license agreement, including, -- without limitation, that your use is for the sole purpose of -- programming logic devices manufactured by Altera and sold by -- Altera or its authorized distributors. Please refer to the -- applicable agreement for further details. -- -- This is a Quartus II output file. It is for reporting purposes only, and is -- not intended for use as a Quartus II input file. This file cannot be used -- to make Quartus II pin assignments - for instructions on how to make pin -- assignments, please see Quartus II help. --------------------------------------------------------------------------------- --------------------------------------------------------------------------------- -- NC : No Connect. This pin has no internal connection to the device. -- DNU : Do Not Use. This pin MUST NOT be connected. -- VCCINT : Dedicated power pin, which MUST be connected to VCC (1.2V). -- VCCIO : Dedicated power pin, which MUST be connected to VCC -- of its bank. -- Bank 1: 3.3V -- Bank 2: 3.3V -- Bank 3: 3.3V -- Bank 4: 3.3V -- Bank 5: 3.3V -- Bank 6: 3.3V -- Bank 7: 3.3V -- Bank 8: 3.3V -- GND : Dedicated ground pin. Dedicated GND pins MUST be connected to GND. -- It can also be used to report unused dedicated pins. The connection -- on the board for unused dedicated pins depends on whether this will -- be used in a future design. One example is device migration. When -- using device migration, refer to the device pin-tables. If it is a -- GND pin in the pin table or if it will not be used in a future design -- for another purpose the it MUST be connected to GND. If it is an unused -- dedicated pin, then it can be connected to a valid signal on the board -- (low, high, or toggling) if that signal is required for a different -- revision of the design. -- GND+ : Unused input pin. It can also be used to report unused dual-purpose pins. -- This pin should be connected to GND. It may also be connected to a -- valid signal on the board (low, high, or toggling) if that signal -- is required for a different revision of the design. -- GND* : Unused I/O pin. For transceiver I/O banks (Bank 13, 14, 15, 16 and 17), -- connect each pin marked GND* either individually through a 10k Ohm resistor -- to GND or tie all pins together and connect through a single 10k Ohm resistor -- to GND. -- For non-transceiver I/O banks, connect each pin marked GND* directly to GND -- or leave it unconnected. -- RESERVED : Unused I/O pin, which MUST be left unconnected. -- RESERVED_INPUT : Pin is tri-stated and should be connected to the board. -- RESERVED_INPUT_WITH_WEAK_PULLUP : Pin is tri-stated with internal weak pull-up resistor. -- RESERVED_INPUT_WITH_BUS_HOLD : Pin is tri-stated with bus-hold circuitry. -- RESERVED_OUTPUT_DRIVEN_HIGH : Pin is output driven high. --------------------------------------------------------------------------------- --------------------------------------------------------------------------------- -- Pin directions (input, output or bidir) are based on device operating in user mode. --------------------------------------------------------------------------------- Quartus II Version 9.0 Internal Build 220 05/13/2009 Service Pack 2 SJ Full Version CHIP "DE0_Default" ASSIGNED TO AN: EP3C16F484C6 Pin Name/Usage : Location : Dir. : I/O Standard : Voltage : I/O Bank : User Assignment ------------------------------------------------------------------------------------------------------------- GND : A1 : gnd : : : : VCCIO8 : A2 : power : : 3.3V : 8 : DRAM_ADDR[1] : A3 : output : 3.3-V LVTTL : : 8 : Y DRAM_BA_1 : A4 : output : 3.3-V LVTTL : : 8 : Y DRAM_ADDR[4] : A5 : output : 3.3-V LVTTL : : 8 : Y DRAM_ADDR[7] : A6 : output : 3.3-V LVTTL : : 8 : Y DRAM_ADDR[11] : A7 : output : 3.3-V LVTTL : : 8 : Y DRAM_DQ[8] : A8 : bidir : 3.3-V LVTTL : : 8 : Y DRAM_DQ[10] : A9 : bidir : 3.3-V LVTTL : : 8 : Y DRAM_DQ[13] : A10 : bidir : 3.3-V LVTTL : : 8 : Y GND+ : A11 : : : : 8 : GND+ : A12 : : : : 7 : HEX1_D[0] : A13 : output : 3.3-V LVTTL : : 7 : Y HEX1_D[3] : A14 : output : 3.3-V LVTTL : : 7 : Y HEX1_D[6] : A15 : output : 3.3-V LVTTL : : 7 : Y HEX2_D[1] : A16 : output : 3.3-V LVTTL : : 7 : Y HEX2_D[4] : A17 : output : 3.3-V LVTTL : : 7 : Y HEX2_DP : A18 : output : 3.3-V LVTTL : : 7 : Y HEX3_D[2] : A19 : output : 3.3-V LVTTL : : 7 : Y RESERVED_INPUT_WITH_WEAK_PULLUP : A20 : : : : 7 : VCCIO7 : A21 : power : : 3.3V : 7 : GND : A22 : gnd : : : : FL_BYTE_N : AA1 : output : 3.3-V LVTTL : : 2 : Y FL_ADDR[16] : AA2 : output : 3.3-V LVTTL : : 2 : Y GPIO0_CLKOUT[1] : AA3 : output : 3.3-V LVTTL : : 3 : Y GPIO0_D[15] : AA4 : bidir : 3.3-V LVTTL : : 3 : Y GPIO0_D[13] : AA5 : bidir : 3.3-V LVTTL : : 3 : Y VCCIO3 : AA6 : power : : 3.3V : 3 : GPIO1_D[16] : AA7 : bidir : 3.3-V LVTTL : : 3 : Y GPIO0_D[11] : AA8 : bidir : 3.3-V LVTTL : : 3 : Y GPIO1_D[15] : AA9 : bidir : 3.3-V LVTTL : : 3 : Y GPIO0_D[9] : AA10 : bidir : 3.3-V LVTTL : : 3 : Y GPIO1_CLKIN[1] : AA11 : input : 3.3-V LVTTL : : 3 : Y GPIO0_CLKIN[1] : AA12 : input : 3.3-V LVTTL : : 4 : Y GPIO0_D[7] : AA13 : bidir : 3.3-V LVTTL : : 4 : Y GPIO0_D[4] : AA14 : bidir : 3.3-V LVTTL : : 4 : Y GPIO0_D[2] : AA15 : bidir : 3.3-V LVTTL : : 4 : Y GPIO0_D[1] : AA16 : bidir : 3.3-V LVTTL : : 4 : Y GPIO1_D[6] : AA17 : bidir : 3.3-V LVTTL : : 4 : Y GPIO1_D[5] : AA18 : bidir : 3.3-V LVTTL : : 4 : Y GPIO1_D[2] : AA19 : bidir : 3.3-V LVTTL : : 4 : Y GPIO1_D[0] : AA20 : bidir : 3.3-V LVTTL : : 4 : Y RESERVED_INPUT_WITH_WEAK_PULLUP : AA21 : : : : 5 : SD_DAT0 : AA22 : bidir : 3.3-V LVTTL : : 5 : Y GND : AB1 : gnd : : : : VCCIO3 : AB2 : power : : 3.3V : 3 : GPIO0_CLKOUT[0] : AB3 : output : 3.3-V LVTTL : : 3 : Y GPIO0_D[14] : AB4 : bidir : 3.3-V LVTTL : : 3 : Y GPIO0_D[12] : AB5 : bidir : 3.3-V LVTTL : : 3 : Y GND : AB6 : gnd : : : : GPIO1_D[17] : AB7 : bidir : 3.3-V LVTTL : : 3 : Y GPIO0_D[10] : AB8 : bidir : 3.3-V LVTTL : : 3 : Y GPIO1_D[14] : AB9 : bidir : 3.3-V LVTTL : : 3 : Y GPIO0_D[8] : AB10 : bidir : 3.3-V LVTTL : : 3 : Y GPIO1_CLKIN[0] : AB11 : input : 3.3-V LVTTL : : 3 : Y GPIO0_CLKIN[0] : AB12 : input : 3.3-V LVTTL : : 4 : Y GPIO0_D[6] : AB13 : bidir : 3.3-V LVTTL : : 4 : Y GPIO0_D[5] : AB14 : bidir : 3.3-V LVTTL : : 4 : Y GPIO0_D[3] : AB15 : bidir : 3.3-V LVTTL : : 4 : Y GPIO0_D[0] : AB16 : bidir : 3.3-V LVTTL : : 4 : Y GPIO1_D[7] : AB17 : bidir : 3.3-V LVTTL : : 4 : Y GPIO1_D[4] : AB18 : bidir : 3.3-V LVTTL : : 4 : Y GPIO1_D[3] : AB19 : bidir : 3.3-V LVTTL : : 4 : Y GPIO1_D[1] : AB20 : bidir : 3.3-V LVTTL : : 4 : Y VCCIO4 : AB21 : power : : 3.3V : 4 : GND : AB22 : gnd : : : : LEDG[9] : B1 : output : 3.3-V LVTTL : : 1 : Y LEDG[8] : B2 : output : 3.3-V LVTTL : : 1 : Y DRAM_ADDR[2] : B3 : output : 3.3-V LVTTL : : 8 : Y DRAM_ADDR[10] : B4 : output : 3.3-V LVTTL : : 8 : Y DRAM_BA_0 : B5 : output : 3.3-V LVTTL : : 8 : Y DRAM_ADDR[6] : B6 : output : 3.3-V LVTTL : : 8 : Y DRAM_ADDR[9] : B7 : output : 3.3-V LVTTL : : 8 : Y DRAM_UDQM : B8 : output : 3.3-V LVTTL : : 8 : Y DRAM_DQ[9] : B9 : bidir : 3.3-V LVTTL : : 8 : Y DRAM_DQ[12] : B10 : bidir : 3.3-V LVTTL : : 8 : Y GND+ : B11 : : : : 8 : CLOCK_50_2 : B12 : input : 3.3-V LVTTL : : 7 : Y HEX1_D[1] : B13 : output : 3.3-V LVTTL : : 7 : Y HEX1_D[4] : B14 : output : 3.3-V LVTTL : : 7 : Y HEX1_DP : B15 : output : 3.3-V LVTTL : : 7 : Y HEX2_D[2] : B16 : output : 3.3-V LVTTL : : 7 : Y HEX2_D[5] : B17 : output : 3.3-V LVTTL : : 7 : Y HEX3_D[0] : B18 : output : 3.3-V LVTTL : : 7 : Y HEX3_D[3] : B19 : output : 3.3-V LVTTL : : 7 : Y RESERVED_INPUT_WITH_WEAK_PULLUP : B20 : : : : 7 : LCD_DATA[5] : B21 : bidir : 3.3-V LVTTL : : 6 : Y LCD_DATA[4] : B22 : bidir : 3.3-V LVTTL : : 6 : Y LEDG[6] : C1 : output : 3.3-V LVTTL : : 1 : Y LEDG[7] : C2 : output : 3.3-V LVTTL : : 1 : Y DRAM_ADDR[3] : C3 : output : 3.3-V LVTTL : : 8 : Y DRAM_ADDR[0] : C4 : output : 3.3-V LVTTL : : 8 : Y GND : C5 : gnd : : : : DRAM_ADDR[5] : C6 : output : 3.3-V LVTTL : : 8 : Y DRAM_ADDR[8] : C7 : output : 3.3-V LVTTL : : 8 : Y DRAM_ADDR[12] : C8 : output : 3.3-V LVTTL : : 8 : Y GND : C9 : gnd : : : : DRAM_DQ[11] : C10 : bidir : 3.3-V LVTTL : : 8 : Y GND : C11 : gnd : : : : GND : C12 : gnd : : : : HEX1_D[2] : C13 : output : 3.3-V LVTTL : : 7 : Y GND : C14 : gnd : : : : RESERVED_INPUT_WITH_WEAK_PULLUP : C15 : : : : 7 : GND : C16 : gnd : : : : RESERVED_INPUT_WITH_WEAK_PULLUP : C17 : : : : 7 : GND : C18 : gnd : : : : HEX3_D[4] : C19 : output : 3.3-V LVTTL : : 7 : Y LCD_DATA[7] : C20 : bidir : 3.3-V LVTTL : : 6 : Y LCD_DATA[3] : C21 : bidir : 3.3-V LVTTL : : 6 : Y LCD_DATA[2] : C22 : bidir : 3.3-V LVTTL : : 6 : Y ~ALTERA_ASDO_DATA1~ / RESERVED_INPUT_WITH_WEAK_PULLUP : D1 : input : 3.3-V LVTTL : : 1 : N SW[9] : D2 : input : 3.3-V LVTTL : : 1 : Y GND : D3 : gnd : : : : VCCIO1 : D4 : power : : 3.3V : 1 : VCCIO8 : D5 : power : : 3.3V : 8 : DRAM_WE_N : D6 : output : 3.3-V LVTTL : : 8 : Y GND : D7 : gnd : : : : GND : D8 : gnd : : : : VCCIO8 : D9 : power : : 3.3V : 8 : DRAM_DQ[0] : D10 : bidir : 3.3-V LVTTL : : 8 : Y VCCIO8 : D11 : power : : 3.3V : 8 : VCCIO7 : D12 : power : : 3.3V : 7 : HEX0_DP : D13 : output : 3.3-V LVTTL : : 7 : Y VCCIO7 : D14 : power : : 3.3V : 7 : HEX2_D[0] : D15 : output : 3.3-V LVTTL : : 7 : Y VCCIO7 : D16 : power : : 3.3V : 7 : RESERVED_INPUT_WITH_WEAK_PULLUP : D17 : : : : 7 : VCCIO7 : D18 : power : : 3.3V : 7 : HEX3_D[5] : D19 : output : 3.3-V LVTTL : : 7 : Y LCD_DATA[6] : D20 : bidir : 3.3-V LVTTL : : 6 : Y LCD_DATA[1] : D21 : bidir : 3.3-V LVTTL : : 6 : Y LCD_DATA[0] : D22 : bidir : 3.3-V LVTTL : : 6 : Y LEDG[5] : E1 : output : 3.3-V LVTTL : : 1 : Y ~ALTERA_FLASH_nCE_nCSO~ / RESERVED_INPUT_WITH_WEAK_PULLUP : E2 : input : 3.3-V LVTTL : : 1 : N SW[7] : E3 : input : 3.3-V LVTTL : : 1 : Y SW[8] : E4 : input : 3.3-V LVTTL : : 1 : Y DRAM_CLK : E5 : output : 3.3-V LVTTL : : 8 : Y DRAM_CKE : E6 : output : 3.3-V LVTTL : : 8 : Y DRAM_LDQM : E7 : output : 3.3-V LVTTL : : 8 : Y VCCIO8 : E8 : power : : 3.3V : 8 : DRAM_DQ[3] : E9 : bidir : 3.3-V LVTTL : : 8 : Y DRAM_DQ[14] : E10 : bidir : 3.3-V LVTTL : : 8 : Y HEX0_D[0] : E11 : output : 3.3-V LVTTL : : 7 : Y RESERVED_INPUT_WITH_WEAK_PULLUP : E12 : : : : 7 : RESERVED_INPUT_WITH_WEAK_PULLUP : E13 : : : : 7 : HEX1_D[5] : E14 : output : 3.3-V LVTTL : : 7 : Y HEX2_D[3] : E15 : output : 3.3-V LVTTL : : 7 : Y RESERVED_INPUT_WITH_WEAK_PULLUP : E16 : : : : 7 : VCCD_PLL2 : E17 : power : : 1.2V : : GNDA2 : E18 : gnd : : : : VCCIO6 : E19 : power : : 3.3V : 6 : GND : E20 : gnd : : : : LCD_EN : E21 : output : 3.3-V LVTTL : : 6 : Y LCD_RW : E22 : output : 3.3-V LVTTL : : 6 : Y BUTTON[2] : F1 : input : 3.3-V LVTTL : : 1 : Y LEDG[4] : F2 : output : 3.3-V LVTTL : : 1 : Y GND : F3 : gnd : : : : VCCIO1 : F4 : power : : 3.3V : 1 : GNDA3 : F5 : gnd : : : : VCCD_PLL3 : F6 : power : : 1.2V : : DRAM_RAS_N : F7 : output : 3.3-V LVTTL : : 8 : Y DRAM_DQ[7] : F8 : bidir : 3.3-V LVTTL : : 8 : Y DRAM_DQ[4] : F9 : bidir : 3.3-V LVTTL : : 8 : Y DRAM_DQ[15] : F10 : bidir : 3.3-V LVTTL : : 8 : Y HEX0_D[1] : F11 : output : 3.3-V LVTTL : : 7 : Y HEX0_D[5] : F12 : output : 3.3-V LVTTL : : 7 : Y HEX0_D[6] : F13 : output : 3.3-V LVTTL : : 7 : Y HEX2_D[6] : F14 : output : 3.3-V LVTTL : : 7 : Y HEX3_D[1] : F15 : output : 3.3-V LVTTL : : 7 : Y RESERVED_INPUT_WITH_WEAK_PULLUP : F16 : : : : 7 : RESERVED_INPUT_WITH_WEAK_PULLUP : F17 : : : : 6 : VCCA2 : F18 : power : : 2.5V : : RESERVED_INPUT_WITH_WEAK_PULLUP : F19 : : : : 6 : RESERVED_INPUT_WITH_WEAK_PULLUP : F20 : : : : 6 : LCD_BLON : F21 : output : 3.3-V LVTTL : : 6 : Y LCD_RS : F22 : output : 3.3-V LVTTL : : 6 : Y GND+ : G1 : : : : 1 : GND+ : G2 : : : : 1 : BUTTON[1] : G3 : input : 3.3-V LVTTL : : 1 : Y SW[3] : G4 : input : 3.3-V LVTTL : : 1 : Y SW[4] : G5 : input : 3.3-V LVTTL : : 1 : Y VCCA3 : G6 : power : : 2.5V : : DRAM_CS_N : G7 : output : 3.3-V LVTTL : : 8 : Y DRAM_CAS_N : G8 : output : 3.3-V LVTTL : : 8 : Y DRAM_DQ[5] : G9 : bidir : 3.3-V LVTTL : : 8 : Y DRAM_DQ[1] : G10 : bidir : 3.3-V LVTTL : : 8 : Y RESERVED_INPUT_WITH_WEAK_PULLUP : G11 : : : : 8 : HEX0_D[4] : G12 : output : 3.3-V LVTTL : : 7 : Y RESERVED_INPUT_WITH_WEAK_PULLUP : G13 : : : : 7 : RESERVED_INPUT_WITH_WEAK_PULLUP : G14 : : : : 7 : HEX3_D[6] : G15 : output : 3.3-V LVTTL : : 7 : Y HEX3_DP : G16 : output : 3.3-V LVTTL : : 7 : Y RESERVED_INPUT_WITH_WEAK_PULLUP : G17 : : : : 6 : RESERVED_INPUT_WITH_WEAK_PULLUP : G18 : : : : 6 : VCCIO6 : G19 : power : : 3.3V : 6 : GND : G20 : gnd : : : : CLOCK_50 : G21 : input : 3.3-V LVTTL : : 6 : Y GND+ : G22 : : : : 6 : LEDG[3] : H1 : output : 3.3-V LVTTL : : 1 : Y BUTTON[0] : H2 : input : 3.3-V LVTTL : : 1 : Y GND : H3 : gnd : : : : VCCIO1 : H4 : power : : 3.3V : 1 : SW[1] : H5 : input : 3.3-V LVTTL : : 1 : Y SW[2] : H6 : input : 3.3-V LVTTL : : 1 : Y SW[6] : H7 : input : 3.3-V LVTTL : : 1 : Y GND : H8 : gnd : : : : DRAM_DQ[6] : H9 : bidir : 3.3-V LVTTL : : 8 : Y DRAM_DQ[2] : H10 : bidir : 3.3-V LVTTL : : 8 : Y RESERVED_INPUT_WITH_WEAK_PULLUP : H11 : : : : 8 : HEX0_D[2] : H12 : output : 3.3-V LVTTL : : 7 : Y HEX0_D[3] : H13 : output : 3.3-V LVTTL : : 7 : Y RESERVED_INPUT_WITH_WEAK_PULLUP : H14 : : : : 7 : RESERVED_INPUT_WITH_WEAK_PULLUP : H15 : : : : 7 : RESERVED_INPUT_WITH_WEAK_PULLUP : H16 : : : : 6 : VGA_R[1] : H17 : output : 3.3-V LVTTL : : 6 : Y RESERVED_INPUT_WITH_WEAK_PULLUP : H18 : : : : 6 : VGA_R[0] : H19 : output : 3.3-V LVTTL : : 6 : Y VGA_R[2] : H20 : output : 3.3-V LVTTL : : 6 : Y VGA_R[3] : H21 : output : 3.3-V LVTTL : : 6 : Y VGA_G[0] : H22 : output : 3.3-V LVTTL : : 6 : Y LEDG[0] : J1 : output : 3.3-V LVTTL : : 1 : Y LEDG[1] : J2 : output : 3.3-V LVTTL : : 1 : Y LEDG[2] : J3 : output : 3.3-V LVTTL : : 1 : Y RESERVED_INPUT_WITH_WEAK_PULLUP : J4 : : : : 1 : GND : J5 : gnd : : : : SW[0] : J6 : input : 3.3-V LVTTL : : 1 : Y SW[5] : J7 : input : 3.3-V LVTTL : : 1 : Y VCCINT : J8 : power : : 1.2V : : GND : J9 : gnd : : : : VCCINT : J10 : power : : 1.2V : : VCCINT : J11 : power : : 1.2V : : VCCINT : J12 : power : : 1.2V : : VCCINT : J13 : power : : 1.2V : : VCCINT : J14 : power : : 1.2V : : RESERVED_INPUT_WITH_WEAK_PULLUP : J15 : : : : 6 : RESERVED_INPUT_WITH_WEAK_PULLUP : J16 : : : : 6 : VGA_G[1] : J17 : output : 3.3-V LVTTL : : 6 : Y RESERVED_INPUT_WITH_WEAK_PULLUP : J18 : : : : 6 : GND : J19 : gnd : : : : VCCIO6 : J20 : power : : 3.3V : 6 : VGA_G[3] : J21 : output : 3.3-V LVTTL : : 6 : Y VGA_B[2] : J22 : output : 3.3-V LVTTL : : 6 : Y ~ALTERA_DATA0~ / RESERVED_INPUT_WITH_WEAK_PULLUP : K1 : input : 3.3-V LVTTL : : 1 : N ~ALTERA_DCLK~ : K2 : output : 3.3-V LVTTL : : 1 : N GND : K3 : gnd : : : : VCCIO1 : K4 : power : : 3.3V : 1 : nCONFIG : K5 : : : : 1 : nSTATUS : K6 : : : : 1 : RESERVED_INPUT_WITH_WEAK_PULLUP : K7 : : : : 1 : RESERVED_INPUT_WITH_WEAK_PULLUP : K8 : : : : 1 : VCCINT : K9 : power : : 1.2V : : GND : K10 : gnd : : : : GND : K11 : gnd : : : : GND : K12 : gnd : : : : GND : K13 : gnd : : : : VCCINT : K14 : power : : 1.2V : : RESERVED_INPUT_WITH_WEAK_PULLUP : K15 : : : : 6 : RESERVED_INPUT_WITH_WEAK_PULLUP : K16 : : : : 6 : VGA_G[2] : K17 : output : 3.3-V LVTTL : : 6 : Y VGA_B[3] : K18 : output : 3.3-V LVTTL : : 6 : Y RESERVED_INPUT_WITH_WEAK_PULLUP : K19 : : : : 6 : MSEL3 : K20 : : : : 6 : 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